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内存装置

발명알 수 없음
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§ Ⅰ

개요

발명자

陈宗仁

출원일

Feb 26, 2026

공개일

Oct 16, 2026

IPC 분류

G11C 16/04 (2006.01)G11C 16/08 (2006.01)

本发明提供一种内存装置。第一选择电路依据被选择的偶数内存区块将第一全局字线译码器选择连接至部分的第一全局字线。第二选择电路依据被选择的偶数内存区块将第一全局字线选择信号传送给被选择的偶数内存区块。第三选择电路依据被选择的奇数内存区块将第二全局字线译码器选择连接至部分的第二全局字线。第四选择电路依据被选择的奇数内存区块将第二全局字线选择信号传送给被选择的奇数内存区块。