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Dossier

包括屏蔽层和阻挡图案的半导体封装

InventionUnknown
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§ Ⅰ

Dossier Overview

Inventor

郑锜泓; 白起源; 金承玟; 金洪珍

Filing Date

Nov 26, 2025

Publication Date

Oct 16, 2026

IPC Classification

H10W 42/20 (2026.01)H10W 74/10 (2026.01)H10W 72/90 (2026.01)H10W 72/20 (2026.01)H10W 72/29 (2026.01)H10W 70/652 (2026.01)H10W 70/68 (2026.01)

一种半导体封装,包括:衬底,包括第一和第二表面、第一表面上的第一焊盘、第二表面上的第二焊盘、以及沿第二表面的边缘围绕第二焊盘的阻挡图案;半导体芯片,在第一表面上并且包括电连接到第一焊盘的连接焊盘;在半导体芯片上的模制层;绝缘层,在第二焊盘中的每一个的一部分上并且包括敞开区域,敞开区域沿着第二表面的边缘暴露阻挡图案的一部分;以及屏蔽层,在衬底和模制层中的每一个的至少一部分上,并且包括从第二表面的边缘延伸到敞开区域的插入部分,其中插入部分的厚度朝向绝缘层的与敞开区域相邻的外表面减小。

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